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标题: system verilog package的使用 [打印本页]

作者: 雨后空 时间: 2020-3-9 20:51
标题: system verilog package的使用
文章简介：昨天想优化seuqence的代码，每个sequence中都有transa

昨天想优化seuqence的代码，每个sequence中都有transaction的使用，将代码import在sequence的顶層v_seq.sv中，编译发生pkg can not be bound的错误，所以想问一下众神是否有好的意见。

作者: 开心青年 时间: 2020-3-9 20:51
能贴下全的VCS 的log 吗？

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