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标题: interface with clocking block [打印本页]

作者: 彩虹网 时间: 2020-4-7 18:51
标题: interface with clocking block
system verilog 提供了这个功能。
如果有master，slave，但clock都是从testbench驱动的，應該挺好用。
但是，如果是一个vip驱动clock，就麻烦了。有什么解决方法吗？

作者: 开心青年 时间: 2020-4-7 18:51
一样的呀，难道vip没有对外的if。

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